In diesem Webinar stellen wir die Methodik auf Transaktionsebene (TLM) vor und zeigen, wie sie für die Verifizierung von PCIe-basierten FPGA-Designs im Hinblick auf die DO-254-Konformität verwendet werden kann. Transaktionen sind einfacher zu verwalten und mit den Simulationsergebnissen zu korrelieren, so dass die Rückverfolgbarkeit viel einfacher zu gewährleisten ist. Außerdem sind die mit TLM verwendeten zeitunabhängigen Testbenches unempfindlich gegenüber Taktfrequenz- und Phasenänderungen, was ideal für die Verifizierung von PCIe-basierten FPGA-Designs mit nicht-deterministischem Verhalten ist.
Wir werden auch einen vollständigen Ablauf unter Verwendung von TLM von der Simulation bis hin zum physikalischen Testen des FPGAs mit unserer beliebten CTS-Plattform zeigen.
Agenda:
- Typische Architektur eines PCIe-basierten FPGA-Designs
- Herausforderungen bei der Verifikation
- Einführung von TLM
- Unterschiede zwischen Bit-Ebene und Transaktions-Ebene
- Vorteile von TLM
- Simulation und physikalischer Test des Ziel-FPGAs mit TLM
- Q&A
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